2018年重庆理工大学光电信息学院804电子技术[专业硕士]之电子技术基础-数字部分考研基础五套测试题
● 摘要
一、简答题
1． 试用PLA 电路设计一个2位二进制数的加法器。设这两个2
位二进制数分别为
【答案】若按照串行加法方式计算，两个低位数按半加运算的真值表及输出函数如表 （a ）
所列，两个高位数按全加运算的真值表及输出函数如表 （b ）所列。
表 （a ）半加运算真值表 表 （b ）全加运算的真值表
用PLA 电路实现的两个2位二进制数的加法器与阵列图如图所示。
图 二进制数的加法器与阵列图
2． 写出JK 触发器和D 触发器的特性方程，并用JK 触发器构成D 触发器，写出变换关系，画出电路图。
【答案】JK 触发器的特性方程：
D 触发器的特性方程：
先将D 触发器的特性方程变换成与JK 触发器特性方程相似的形式：
将此式与JK 触发器的特性方程相比较得JK 触发器的驱动方程为：J=D，
转换电路图如图所示
据此，画出
图 用JK 触发器构成D 触发器
3． 试用4位并行加法器74LS283设计一个加/减运算电路，当控制信号M=0时它将两个输入4位二进制数相加，而M=1时，它将两个4位二进制数相减。允许附加必要的门电路。74LS283如图（a ）所示。
图（a ）
【答案】
（如下表所列）。
表 为被加数或被减数，和为原值；作减法运算时，
相当于心皂 为加数或者减数。当作加法运算时，的补码相加。根据题意，写出真值表
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而M=1时，将
为减数输入，输出值为和输入M ，当M=0
时将和 直接相加，分别异或作相减，在此采用补码相加的方法，用M 与，输出进位为，则可得电路图如图（b ）所示。
图（b ）
4． 图（a ）所示的虚方框内为一个7只发光二极管组成的共阳极7段数码管，实线框为一个供显示数 码管e 段的译码器。它的输入端A 、B 、C 、D 输入对应于十进制数的二进制数码如图（b ）所示。输出端e 供控制数码管e 段发光与否。
（1）列出e 段译码显示所需电平的真值表。
（2）用卡诺图简化译码电路输入输出间的逻辑关系，并写出简化后的逻辑表达式。
（3）用与非门实现该译码电路，画出译码器逻辑图。
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