2017年中央民族大学信息工程学院856计算机学科专业综合之计算机组成原理考研冲刺密押题
● 摘要
一、分析题
1． 试分析图所示写电流波形属于何种记录方式。
图
【答案】（1）是调频制（FM ）。
（2）是改进调频制（MFM ）。
（3）是调相制（PE ）。
（4）是调频制（FM ）。
（5）是不归零制（NRZ ）。
（6）是“见1就翻制”（NRZ1）。
2． CTU 结构如图所示，其中有一个累加寄存器AC 、一个状态条件寄存器和其他四个寄存器，各部分之间的连线表示数据通路，箭头表示信息传送方向。
（1）标明图中四个寄存器的名称。
（2）简述指令从主存取到控制器的数据通路。
（3）简述数据在运算器和主存之间进行存/取访问的数据通路。
【答案】（1））a 为数据缓冲寄存器DR , b为指令寄存器IR ，c 为主存地址寄存器AR , d为程序计数器PC 。
（2）主存M —缓冲寄存器DR —指令寄存器IR —操作控制器。
（3）存储器读：AR 先置数据地址，
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图
存储器写：AR 先置数据地址，
3． CD-ROM 光盘的外缘有5mm 宽的范围因记录数据困难，一般不使用，故标准的播放时间为60min 。计算模式1和2情况下光盘存储容量是多少？
【答案】扇区总数
模式1存放计算机程序和数据，其存储容量为模式2存放声音、图像等多媒体数据，其存储容量为
4． 比较同步定时与异步定时的优缺点。
【答案】同步定时协议采用公共时钟，具有较高的传输频率。但由于同步总线必须按最慢的模块来设计公共时钟，当各功能模块存取时间相差很大时，会大大损失总线效率。
异步定时的优点是总线周期长度可变，不把响应时间强加到功能模块上，因而允许快速和慢速的功能模块都能连接到同一总线上。但缺点是：总线复杂，成本较高。
5． 浮点数四则运算的基本公式如下：
其中
.
算器的逻辑结构图。
【答案】浮点乘法和除法相对来说比较简单，因为尾数和阶码可以独立处理：浮点乘法只需对尾数作定点乘和阶码作定点加，而浮点除法只需对尾数作定点除和阶码作定点减即可。不论乘法和除法，需将结果规格化。
浮点加减法较复杂，原因在于尾数相加或减之前必须对阶。为此，将较小的阶码X 。
对应的尾数
（1）计算右移位以得到一个新的尾数
. 这样就能与进行运算。因此浮点加减法需要四步运算： ； （定点减法）
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试画出浮点运
（2）将
（3）计算移位以形成. ； （定点加法或减法）
（4）将结果规格化。
图为浮点运算器的结构图。该运算器由两个相对独立的定点运算器组成。阶码部件只进行加、减操作，
实现对阶（求阶差）和阶码加减法操作
部件完成。寄存器尾数部分可进行加、减、乘、除运算，并与阶码部件协同完成对阶和规格化等功能。尾数的加、减由加法器完成，尾数乘除由高速乘除和积商寄存器本身具有移位功能，以便完成对阶和规格化等操作。
图
6． 设变量h 放在寄存器
代码。C 赋值语句是；
【答案】虽然C 语句只有一个相加的操作，但是两个操作数均在存储器中，因此需要更多的ARM 指令。首先用取字（LDR
）指令访问存储器单元
存器最后用存字（STR ）指令将寄存器，位移量为然后用ADD 指令将放在寄中的结果写到存储器单元此时寄存器作为基地址数组A 的基值放在寄存器r3, 请将下面c 语句翻译成ARM 汇编语言因ARM 也是字节寻址。3条ARM 汇编语言指令形式如下：
二、计算题
7． 某处理机主频为40MHz ，数据总线64位，总线仲裁和地址传送需要2个时钟周期，cache 行大小为32字节，主存访问时间为100ns 。
（1） cache 读操作缺失的延迟时间是多少？
（2）总线带宽是多少？
（3）如果用该处理机组成多处理机系统，并将一个cache 行的数据传输至另一个处理机，已知通信建立时间为2两，处理机间数据传输带宽为
多少？
第 4 页，共 32 页 那么远程操作的有效数据传输带宽是