2018年华东师范大学信息科学技术学院通信工程系883电子线路(A)之电子技术基础-数字部分考研基础五套测试题
● 摘要
一、简答题
1. 分析图所示电路的工作原理。
【答案】在图中,555定时器I 和II 均为多谐振荡器,输出矩形波。只有当定时器II 才可能振荡。
555定时器I 和II 的振荡周期分别为
输出高电平的时间:
荡,振荡频率是
在
输出高电平时,555定时器II 振
为高电平时,
图 电路图
2. 分析如图(a )所示电路实现什么功能,并画出波形图。
图(a )
【答案】(1)各触发器的驱动方程为
输出方程为:
(2)将驱动方程代入触发器的特性方程,得触发器的状态方程为
(3)由此可画出状态表如下表所示。
表
根据状态表,可得状态图如图(b )所示。 (4)根据状态图得到时序图如图(c )所示。
图
(5)检查自启动能力。由状态图可知,该电路具有自启动能力。
通过上述分析,可知该电路是一个用JK 触发器构成的具有自启动能力的8421码同步十进制加法计数器。
3. 用MSI 计数芯片74LS161或74LS160设计十三进制计数器。必要时可用少量门电路。
【答案】方法一:异步清0法
电路如图(1)所示。计数脉冲加到CP 输入端,计数控制端EP 、ET 和置数控制端接高电平1,以使
电路允许计数;然后用一个与非门实时监视计数器的状态,当计数到1101(即
上:,立即将计数器强行复0。
)
时,与非门输出低电平,此低电平加到直接复位端
图(1) 用异步清0法和74LS161构成十三进制加计数器
方法二:同步置0法
电路如图图(2)所示,计数脉冲CP 加到CP 输入端;计数控制端EP ,ET 接高电平1(允许计数);直接复位端平加到并行置数控制端
接高电平1(不清0);并行输入数据
均接低电平0;然后
)时,与非门输出低电平,此低电
用一个与非门实时监视计数器的状态,当计数到1100(即
上,使允许并行置数,下一个CP 脉冲到达时计数器即被置数为0000。
图(2) 用同步置0法构成十三进制加计数器
方法三:同步置数法
电路如图(3)所示,图中并行输入数据C=l,
非门输出低电平
,
设置为0011,当电路计数到1111时,
下一个CP 到达后电路状态即变为0011,然后变
为
直到1111。电路有13个状态,故为十三进制计数器。
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